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EDA加速车规芯片设计

车规芯片属于半导体芯片的一个分支。目前芯片策画验证遭遇的很大一个瓶颈便是人才欠缺,对车规芯片来说也是云云。据统计,2020年的IC策画从业者约20万人,不过企

车规芯片属于半导体芯片的一个分支。目前芯片策画验证遭遇的很大一个瓶颈便是人才欠缺,对车规芯片来说也是云云。据统计,2020年的IC策画从业者约20万人,不过企业对人才需求量一经远远高出这个数目,导致正在本年简直每家半导体策画公司都正在牢骚急需的策画验证职员难招。

芯片人才欠缺一方面正在于守旧人才培育形式的亏折,正在这方面咱们很兴奋地看到国家一经构造,况且展开了一系列的EDA的产学研维系项目;另一方面人才欠缺很大水准是因为外洋EDA用具的垄断性和关闭性变成的,这种落伍和关闭性让国内平凡的开采者很难遍及接触,更讲不上二次开采。

车规芯片是一个庞杂的软硬件体例。车载芯片互联从守旧单纯的传感器通过CAN,MOSE,FlexRay总线互联,慢慢转嫁成庞杂的车用以太网(Automotive Ethernet)互联;传输的数据也从以往的调试诊断讯息,提拔到音视频文娱讯息(Infotainment),首要职责(Mission Critical)数据讯息。跟着数据量连接增大,数据实质和延迟确定性愈加首要,车规芯片内部的软件也以是愈加庞杂。

车规芯片也是一个芯片范畴比力卓殊的品种,加倍是它对成效安静有苛厉的哀求。车规芯片的成效安静完全性等第(ASIL)划分哀求芯片正在策画历程中有一系列的苛苛检测和掩盖率陈述。守旧的芯片策画验证手法学很难有用地应付成效安静范畴庞杂的需求,这个离间也正正在促使策画手法的改良。先辈的策画理念能够让效用大幅提拔,加快策画周期,升高芯片安静等第。

要脱离目前车规芯片窘境,征求对外洋半导体厂商、EDA用具的依赖,国内芯片人才欠缺、策画理念落伍等限制,就务必夸大EDA理念,用具,和手法学改良。

O1、EDA理念改良大个人守旧的EDA用具不向群众怒放中央层接口,平凡用户无法二次开采,持久往后导致产物生态关闭,用户群体狭小。芯华章夸大操纵EDA 2.0工夫和理念,采用芯片策画平台效劳(EDaaS(Electronic Design as a Service))形式:用具有机嵌入云原生效劳,同时供应全方位怒放的接口,并遍及地适配到策画验证各项的流程中。用具接口怒放化,用具自己平台化,由此能够让芯片策画和验证加倍主动化智能化;同时EDA 2.0也也许让更众人通过EDaaS介入到芯片策画中,并神速高效地竣工事情;依托EDA 2.0工夫是治理芯片人才瓶颈最有用的式样之一,咱们欲望正在未来看到有更众的嵌入式工程师,体例工程师,乃至软件工程师都能够操纵EDA 2.0工夫,高效地介入芯片策画研发。

O2、EDA用具改良EDA用具为成效安静供应数据撑持,加倍是ISO26262认证所需的定量剖判:失效形式影响与诊断剖判 (Failure Mode Effect and Diagnostic Analysis,简称FMEDA)。正在策画车规芯片时,FMEDA常用的权术便是对芯片举行无意的滞碍注入(intentional fault injection),然后再剖判毛病注入惹起的成效滞碍概率(失效用),以此评定车规芯片的安静完全性等第。

以是,EDA用具需求也许爆发种种滞碍模子(fault model)的测试慰勉。因为芯片中需求注入的毛病数目宏大,品种繁众,守旧仿真用具正在做大周围测试时往往功能低下,泯灭内存宏大,况且仿真功夫冗长。这是由于守旧仿真用具引擎是用心成效验证,它看待滞碍注入来说,内存和CPU开销都是宏大的。

以是,滞碍注入需求EDA公司策画一种卓殊的仿真器引擎,从而升高滞碍注入仿真效用;别的,芯片滞碍注入测试需求仿真器也许惩罚更众的滞碍,且尽恐怕众地并发践诺。因为寻常芯片内部个人逻辑具有条例性和对称性,通过阵势化式样也许涌现少许条例,从而大周围裁减不须要的注入的数目。一朝测试用例的数目裁减了,仿真所需的总功夫就能够减小了,这也能够从另一方面提拔仿真器的效用。

仿真器只是EDA用具改良的一个规范的例子。其他的用具,如阵势验证,也能够针对成效安静做良众加强和优化,征求主动探测安静途途、主动检测要害途途上的可利用的毛病模子:包罗固定开途滞碍(stuck at fault),瞬态滞碍(transient fault),迁徙滞碍(transition fault),桥接滞碍(bridge fault)等。这些工夫将大大提拔车规芯片的验证效用。

O3、策画手法学改良车规芯片差别于消费电子芯片之处,正在于安静性和牢靠性卓殊哀求。车规芯片正在策画之初要做很周到的架构索求,这些前期事情的主意便是为了开始确保安静性,其次抵达ISO26262 认证的哀求。车规芯片为了要确保正在苛苛境况下策画的安静性,屡屡会应用少许卓殊的逻辑成效:好比正在数据流中的采用硬件CRC校验,正在片内SRAM和Flash memory中采用单比特奇偶(parity)校验,数据读取ECC校验,以及芯片电源电压检测;正在限制繁茂型逻辑上采用冗余逻辑,如众个CPU同时惩罚简单职责,输出结果比对,双看门狗(watchdogs)体例,时钟电途备份机制等。要策画这些安静程序闭连的逻辑单位,就需求正在策画初期验证它的须要性,牢靠性,和完全性。

依照现实阅历,咱们举荐正在策画之初尽早引入芯片成效的虚拟模子。这种基于虚拟模子的开采也许让策画师和架构师尽早剖判优化体例,索求差别构架正在安静功能上的上风。一方面策画工程师,正在没有SoC实正在境况的条目下,能够用这些模子验证对庞杂策画做前期剖判,做出功耗功能面积最优的推断;另一方面,验证工程师操纵虚拟模子能够尽早开采白盒测试境况,也能够提进步行庞杂体例的软硬件协同测试,乃至能够将模子编译正在通用限制器里,放正在ECU体例中举行现实现场测试。

虚拟模子具有诸众上风,但它的条件便是需求工程师遍及认识到它的首要性,并正在策画验证中主动索求操纵好它,同时EDA厂商也该当主动和种种芯片IP厂商合营,开采更众丰饶矫健的虚拟模子,并构修利于财产主动兴盛的生态圈。验证测试左移(shift-left)是今朝庞杂芯片策画范畴的倡始的趋向,而正在车规芯片上,咱们以为虚拟模子是一个验证测试左移完满的助力点。总结正在过去的20年里咱们深深地认识到工夫兴盛给芯片行业带来的改良,但同时咱们也越来越急切的需求更强的工夫革新,来知足咱们日益兴盛的芯片行业需求,治理咱们面对的种种离间。咱们确信依托EDA 2.0带来的EDA用具改良,能够治理人才工夫瓶颈题目;订正用具也许更好地升高策画验证效用;遍及应用虚拟模子将会升高架构索求质料、提拔车规芯片安静性。咱们欲望和各个行业的同仁主动索求交换,配合兴盛进取,为咱们国家芯片,征求车规芯片的兴盛,做出奉献!

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作者: sheep

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